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Participant xiaohu125
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QSGMII IP的PCS近端环回出错

你好,

 

环境:vivado2017.4,  FPGA型号是XC7A75T。板卡上有PHY, FPGA, 交换芯片。FPGA与PHY之间接口是S3MII, FPGA与交换芯片接口是4路QSGMII。

 

数据流是:FPGA里的4个QSGMII IP设置为近端PCS环回,测试仪通过光口向百兆PHY打流,PHY收到后,发给FPGA里的S3MII驱动逻辑,然后送到FPGA里QSGMII IP里,在IP里进行PCS环回后,再送出到测试仪。

 

现象是:测试仪发出几千万个包,只收到几万个包。但是如果QSGMII IP设置为近端PMA环回的话,就不会丢包。

 

问题:这是什么原因导致的?应该排查哪部分?怀疑过是A7的收发器BANK电压或参考时钟有问题,但是BANK里的其它QSGMII 环回的话是没有错包的。

 

已经困扰很久了,希望能给解答一下。

 

谢谢

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10 条回复
Participant xiaohu125
Participant

回复: QSGMII IP的PCS近端环回出错

这么久了都没人给回复一下嘛。。。。

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Xilinx Employee
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回复: QSGMII IP的PCS近端环回出错

你的意思是,在PCS近端环回模式下就会出错?但是PMA近端环回模式就不会出错?
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Participant xiaohu125
Participant

回复: QSGMII IP的PCS近端环回出错

抱歉,我写错了。应该是PCS近端环回正确,但是PMA近端环回就出错。

 

可能的原因有哪些?

 

多谢了!

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Xilinx Employee
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回复: QSGMII IP的PCS近端环回出错

复位过吗?
GT修改好环回模式后,一般要再复位下,才能开始正常工作。
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Participant xiaohu125
Participant

回复: QSGMII IP的PCS近端环回出错

没有复位。

 

板子刚开始上电运行几分钟后,pma近端环回是没错的。过了一天的时间,板子出现丢包了,再次pma近端环回就发现有错包了。

 

这是什么原因呢?请专家指教!谢谢

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Xilinx Employee
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回复: QSGMII IP的PCS近端环回出错

那你就插下ILA,抓下内部信号确认下吧。
如果GT报了RXNOTINTABLE错误,那就是信号的问题,多做下GT的RXRESET看看能否解决?如果GT的TX/RXDATA没问题,8B10B解码好的,那看QSGMII的TX/RX数据包是否都有,会不会是这个IP core没有完整的license?
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Participant xiaohu125
Participant

回复: QSGMII IP的PCS近端环回出错

那你就插下ILA,抓下内部信号确认下吧。如果GT报了RXNOTINTABLE错误,那就是信号的问题

好的

 

 

多做下GT的RXRESET看看能否解决?

对GT的RXRESET复位后,PAM环回就正常了

 

 

会不会是这个IP core没有完整的license?

刚看了下vivado中该IP的license状态显示included。应该是没问题的吧

 

 

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Xilinx Employee
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回复: QSGMII IP的PCS近端环回出错

复位下就好了?那就没问题了
可以在vivado工程里面敲命令
report_ip_status
来检查所有用到的IP core的license有没有
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Participant xiaohu125
Participant

回复: QSGMII IP的PCS近端环回出错

我们希望设备一直运行着不会出错,丢包。

 

出错后,用复位只是一种定位手段。

 

请问一下,如何才能让设备一直稳定运行,不出错?

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Xilinx Employee
Xilinx Employee

回复: QSGMII IP的PCS近端环回出错

1. 改完近端PMA loopback模式后,需要复位下,复位后就一直好了;但是改过模式,必须要复位下,才能恢复工作
2. 如果复位后运行着还会出错,没有动过任何loopback或其它输入,突然间出的错误。那你每次大概跑多久,不碰它会突然出错?按我之前的建议,确认license状态,或插ILA检查内部信号帮助debug
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