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ROM仿真问题

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1.使用VCS仿真RAM,使用blk_mem_gen_v8.4.v和blk_mem_gen_0.v,自己写的tb,ram的读写正常; 2.同样产生一个ROM,使用上述两个文件仿真,仿真会停留在初始化后,报警告block memory generator module is behavioral model for simulation which will not precisely model memory collision behavior 3.vcs不认mif文件,在blk_mem_gen_v8.4的C_INIT_FILE_NAME,写入的是完整的mif路径信息,仿真ROM的初始化显示完成! 4.请问ROM怎么仿真?需求是:1,仿真的时候ROM加载mif文件!2,用verilog来仿真(example是VHDL的)!
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好吧,自己解决了,tb写的有点问题

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好吧,自己解决了,tb写的有点问题

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我也遇到了同样的问题,vcs如何识别mif文件呢 

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mif放到vcs的脚本文件下,在blk_mem_gen_0.v指定mif为文件名称即可。