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Observer stone_stone
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关于arm下的linux与PL高速率通信有没有参考资料

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网上找来找去,大多是裸机编程的资料,我现在要在linux应用层实现PS与PL高速率通信,求推荐参考资料,谢谢!

 

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Adventurer
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Xilinx Employee
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高速率交互的话,一般都是使用DMA来实现。

wiki上有个demo,你可以参考一下。

https://xilinx-wiki.atlassian.net/wiki/spaces/A/pages/180977780/Zynq+UltraScale+MPSoC+Base+TRD+2019.2

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Observer stone_stone
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你好!我好像没在这个链接里找到。。。
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Adventurer
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Xilinx Employee
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@stone_stone 

你是没找到reference design吗?在Software描述里有。

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Observer stone_stone
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你好!那实际的数据走向是什么样的呢?本来我的理解是这样的:

1、PL和PS事先约定好一块ddr物理地址,假设为:0x20000~0x80000;

2、PL向这块内存写数据并通知PS;

3、PS启动DMA,从地址直接获取数据到linux用户空间。

但是仔细一想,好像又不对,如果是这样的话,那第3步完全可以直接将地址mmap到用户空间进行读取。所以觉得好像DMA不是这么用的,请问我的理解是不是不对?

谢谢!

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Observer stone_stone
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不是没找到reference design,只是这个链接里面好像讲的是usb相关的
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PL作为一个自定IP是会分配特定的地址的,这个其实都不用管他
我的一个项目是,用dma传输由PS外设进入的数据,用mmap传输PS到PL的指令,这个是低速的,带有中断处理可用UIO
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Observer stone_stone
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你好!如果我不管这个地址,那请问linux驱动层是怎么知道该从哪个地址获取数据的呢?
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自动分配的,你打开block design-address editor就能看到具体的物理地址
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Xilinx Employee
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这是一个视频方面的DEMO,源是从USB或HDMI采集,然后PS处理后,再通过显示器输出。

我认为是一个比较完整的可以学习的DEMO,涉及到了大量的数据交互(PL和PS)。

DMA的好处一是不占用APU,二是块传输效率高。

DMA是内存与内存之间(例如OCM和DDR)或是设备与DDR直接(IP和DDR)或是设备与设备之间(IP与IP)之间的传输。

我理解,PS访问内存其实先访问的是cache,cache中没有命中后,cache再从DDR中读取数据,再给PS。

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Adventurer
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你好,请问 有能跑通的demo吗?我目前也遇到了你的这个问题,给的链接里面驱动,我试了下 没成功

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Adventurer
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应该还要加上设备树的,去论坛上搜索一下应该有

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