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Newbie zhrui_9
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ISERDESE2在芯片编程生成比特流文件时报错

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在Xc7a100t上,使用了ISERDESE2原语,数据是ddr模式,完成1:10的串并转换,并使用bitslip模块,找寻字符边缘。程序进行功能仿真时,仿真的时序与预想的一致。添加管脚约束,生成比特文件也没有报错。但是当添加了.cdc文件后,再进行比特文件生成时,会报错。

PhysDesignRules:2066- Component ISERDESE2_inst is configured for  ISERDESE2. A routethru from the

/ILOGIC_X0Y92/DDLY to /ILOGIC_X0Y92/O pins, configuring a second input path for the DDLY pin is in conflict with

   ISERDESE2 configuration.

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已接受的解答
Moderator
Moderator

回复: ISERDESE2在芯片编程生成比特流文件时报错

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Hi, @zhrui_9 ,

您在ISE中试图插入Chipscope的时候报错,可能是因为把探针加在了IOB中,请先排除这种可能性. (看FPGA内部的信号,不要达到接口上, 包括ISERDES.)

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Moderator
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Hi, @zhrui_9 ,

您在ISE中试图插入Chipscope的时候报错,可能是因为把探针加在了IOB中,请先排除这种可能性. (看FPGA内部的信号,不要达到接口上, 包括ISERDES.)

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Xilinx Employee
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设计中这个IO除了用到ISERDES是否用到了IDELAY?

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Newbie zhrui_9
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没有用到,数据是经过差分转单端后直接输入的
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Moderator
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Hi, @zhrui_9 ,

打开网表看下是否有自动插入的idelay ?

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Newbie zhrui_9
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这个问题解决了,出错原因是cdc中添加了ISERDESE2中的输入信号,去掉这个ddr模式的信号,编译就通过了