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Simulation compile error of Example design file

I face simulation error for compiling the example design file of AC701 board ---- ac701-pcie-rdf0225-2013.2-c,

does anyone have this error and help me solve it?

 

Thanks a lot

 

OS: winXP--x64   32 bit

Tool:Vivado 2013.2

 



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Compiling module secureip.xil_pcie_fuji_mod18
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Compiling module secureip.xil_pcie_fuji_mod6
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ERROR: [XSIM 43-3294] Signal EXCEPTION_ACCESS_VIOLATION received
ERROR: [XSIM 43-3294] Signal EXCEPTION_ACCESS_VIOLATION received




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Xilinx Employee
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Registered: ‎02-06-2013

Re: Simulation compile error of Example design file

 

Hi

 

Can you try in latest vivado 2014.2 as there are few known issues in older versions.

 

 

Regards,

Satish

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Re: Simulation compile error of Example design file

I just wonder if there is any solution for this except installing the new version vivado 2014

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Moderator
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Registered: ‎01-16-2013

Re: Simulation compile error of Example design file

Hi,

1)Are you using multiple BD in your design?
--> If yes, then check if you are sharing any IP with same name in both BD.

2) Please check any port mismatch between wraper file and test bench.

3) Also try using different OS.

Thanks,
Yash
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Visitor
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Registered: ‎09-22-2014

Re: Simulation compile error of Example design file

Hi Yash,

 

Can you simulate ac701-pcie-rdf0225-2013.2-c file on vivado 2013.2 Version for window xp  x86?

 

Thanks.

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