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Visitor 125215153
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注册日期: ‎09-11-2012

关于GTH PMA环回问题

大家好,最近参考XAPP1248做一个SDI接口功能,速率为最大为3G,设计工具VIVADO2018.3,FPGA为ZCU4EV784,此为前提

目前状态是SDI输出正常,包括576P、1080P的都正常。输入却一直不对,具体表现为RXRESETDONE一直为低,进一步查看发现RX_STATE一直卡在0X15出不来,经查找是RX_USRCLK_active那个信号一直无效,导致复位状态机一直未完成。

在以上情况做了如下尝试:

1、增加LOOPBACK_in接口,当设置为3'b000,即正常模式情况和上述一致;

2、当LOOPBACK_IN设置为3'b001时,即near_end pcs时,rx能正常工作,并且状态和TX一致;

3、当LOOPBACK_IN设置为3'b010,即near_end pma时,情况和上面描述一致,仍然RXRESETDONE一直为低,参考文档描述对GT进行全部复位,仍无改善;

请教下大家当PMA环回不对的情况可能是什么原因导致的,不胜感激!

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回复: 关于SDI PMA环回问题

这个问题应该是GT的问题,可以把问题的标题修改一下,这样问题更明确.

另外从问题的描述看 "目前状态是SDI输出正常,包括576P、1080P的都正常。输入却一直不对,具体表现为RXRESETDONE一直为低", 这句话比较模糊,如果SDI工作正常, GT的resetdone不应该为低, 而且输出正常,输入不对? 这个怎么理解?

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Visitor 125215153
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注册日期: ‎09-11-2012

回复: 关于SDI PMA环回问题

GT下面分别有两个reset逻辑,一个发送一个接收,目前发送端的复位逻辑都是正常的,也能正常输出,而接收端的RXRESETDONE一直没起来,进一步查看是CDR的恢复时钟没有出来导致的,抓取了rx的几个clksel也都是正确
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注册日期: ‎08-01-2007

回复: 关于SDI PMA环回问题

GT的PLL lock? PLL选择的reference clock correct?

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Visitor 125215153
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注册日期: ‎09-11-2012

回复: 关于SDI PMA环回问题

通过和手册对比及信号抓取,可以确认设置是对的,同时也做过TX和RX参考时钟交换,情况照旧,现在有点怀疑是GTHE4_COMMON的设置不对了,因为xapp1248是例化的GTHE3_COMMON的原语,我做了修改,不知道哪里能找到针对SDI的GTHE4_COMMON的原语

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Visitor 125215153
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GT已LOCK

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Xilinx Employee
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注册日期: ‎05-01-2013

回复: 关于GTH PMA环回问题

改为near end PMA环回(010)后,有没有再单独做下GTRXRESET?或者做个整体复位也可以

有没有用?

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Visitor 125215153
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注册日期: ‎09-11-2012

回复: 关于GTH PMA环回问题

设置成010时,整体复位试过,情况如初,按照xapp1248的设置,gtrxreset端口是灰色的,不能使能,不过也尝试过ip设成global,手动添加了这个端口,经测试还是照旧

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