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suswhoo
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注册日期: ‎12-12-2018

gty txelecidle

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芯片,vcu118开发板 

vivado版本 2018.3

仿真时候,txdata发送SATA ALIGN起始信号K28.5,但是在txelecidle拉低时候,gtyp上最早出现的几个bit不是K28.5,后面3个DWORD为正常的ALIGN。这是起始时候的噪声干扰?GT IP配置时候可以改善这个地方的选项吗?

gtyp_wave.jpg
gtyp_wave1.jpg
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1 解答

已接受的解答
shengjie
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注册日期: ‎07-01-2019

你好 @suswhoo ,

 

我查到了一些类似的问题,但给的方法会不同,两种方式你都可以试一下:

1. 如上面帖子所说,开启PCS_PCIE_EN

2. 使用TXINHIBIT来屏蔽掉这些抖动

如下有一段对这个问题的分析:

The characters that come out at that point should not cause you problems. There is no way for a receiver to be locked onto a RX signal at that point so the glitches should not cause trouble. There are not enough to be confused for any OOB sleep/wake signals. You can use TXINHIBIT to mask those glitches if you choose which would make for a smoother transition.

所以建议你可以评估一下这个抖动具体的影响,在你的设计案例中是不是会对RX造成影响。

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shengjie
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注册日期: ‎07-01-2019

你好 @suswhoo ,

 

尝试将PCS_PCIE_EN改为TRUE试一下

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suswhoo
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611 次查看
注册日期: ‎12-12-2018

您好,您说的PCS_PCIE_EN这个信号在哪里?我在GT这个IP的port里没有找到这个信号名啊?

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shengjie
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581 次查看
注册日期: ‎07-01-2019

是GTY Channel的一个属性设置,不是端口。因为你目前是仿真,可以找一下这个属性是从哪里传参到GT Channel原语的,修改一下看看这个现象是否就消失了?

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suswhoo
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566 次查看
注册日期: ‎12-12-2018

非常感谢您的解答。按照您的建议,将PCS_PCIE_EN设置为TRUE之后,波形没有乱码了,但是最开始由Z态变为0时候应该有两个bit的0(K28.5  0101111100),可是实际波形只有不到1bit的0,这还可能跟哪个信号有关系?

gtyp_wave_los_00.jpg
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shengjie
Moderator
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461 次查看
注册日期: ‎07-01-2019

你好 @suswhoo ,

 

我查到了一些类似的问题,但给的方法会不同,两种方式你都可以试一下:

1. 如上面帖子所说,开启PCS_PCIE_EN

2. 使用TXINHIBIT来屏蔽掉这些抖动

如下有一段对这个问题的分析:

The characters that come out at that point should not cause you problems. There is no way for a receiver to be locked onto a RX signal at that point so the glitches should not cause trouble. There are not enough to be confused for any OOB sleep/wake signals. You can use TXINHIBIT to mask those glitches if you choose which would make for a smoother transition.

所以建议你可以评估一下这个抖动具体的影响,在你的设计案例中是不是会对RX造成影响。

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suswhoo
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400 次查看
注册日期: ‎12-12-2018

您好,非常感谢您的解答。目前仿真阶段加了一点逻辑,以保证gtyp上的信号可以正确被VIP识别,现在仿真阶段是通过了;接下来要评估综合后,FPGA网表下有无影响。另外关于TXINHIBIT这个信号屏蔽抖动的,我在论坛上也有看到,自己也尝试过,但是没有得到我希望的结果,我在ug578也没有找到这个信号与txelecidle之间的关系,请问这个资料那里可以找到呢?

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shengjie
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357 次查看
注册日期: ‎07-01-2019

https://forums.xilinx.com/t5/Serial-Transceivers/GTH-occur-Noise-when-the-TXELECIDLE-is-asserted/m-p/1062838#M6526

有按照这个帖子尝试过吗?这两个信号的关系我们内部也找不到

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suswhoo
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298 次查看
注册日期: ‎12-12-2018

您好,您分享的帖子之前有看到过,按照帖子的内容做过尝试,但是没有得到预期的结果。谢谢!

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