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sdx2019使用opencl开发,如何高速取内核数据?

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开发环境:Sdx2019

       主机端采用opencl开发,内核端使用RTL开发。使用sdx的RTL开发向导生成内核文件,增加了两个全局变量,一个用于主机读数据,一个用于主机写数据,数据位宽选择128Bytes。

目的:我想使用sdx自动生成的主机文件修改实现我的需求。需求是实现和内核的数据高速交换。单次读写交换速率要求最小1GB/s。

验证思路:在主机端修改代码,内核部分暂不变化。循环读取内核读数据接口,并写入文件,持续一秒。

问题:

      1、每次只能读到16k数据,增大读buff后,16k后面的数据读不到;

      2、文档建议每次最少读取1M以上的数据来提高效率,这个具体应该如何实现?

求大神指点迷津!!

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回复: sdx2019使用opencl开发,如何高速取内核数据?

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Hi @lee479 ,

 

Vitis Accel Examples中有不少例子,建议你参考下看看?

我在U200上尝试过这个例子,传输1G的数据没有问题:https://github.com/Xilinx/Vitis_Accel_Examples/blob/master/cpp_kernels/kernel_global_bandwidth/src/kernel_global_bandwidth.cpp

另外在以下目录中也有不少RTL kernel的例子可以参考下:

https://github.com/Xilinx/Vitis_Accel_Examples/tree/master/rtl_kernels

如果你可以用这里面的例子复现问题,我这边也可以尝试下看看。

Best Regards,
Jason
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Hi @lee479 ,

 

Vitis Accel Examples中有不少例子,建议你参考下看看?

我在U200上尝试过这个例子,传输1G的数据没有问题:https://github.com/Xilinx/Vitis_Accel_Examples/blob/master/cpp_kernels/kernel_global_bandwidth/src/kernel_global_bandwidth.cpp

另外在以下目录中也有不少RTL kernel的例子可以参考下:

https://github.com/Xilinx/Vitis_Accel_Examples/tree/master/rtl_kernels

如果你可以用这里面的例子复现问题,我这边也可以尝试下看看。

Best Regards,
Jason
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