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如何把IP 的 constraint propagate至top level?

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把clocking wizard IP 產生的block 的reset pin 接至i/o port.  synthesis 後自動插入了一個IBUG 及產生[NETLIST 29-160] cannot set property BOARD_PIN error.   請問如何解決?

 

test.png

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Xilinx Employee
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回复: 如何把IP 的 constraint propagate至top level?

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这个IBUF是必须的,其他的管脚没有是因为都是差分的,而在子模块里有IBUFDS所以不需要再添加。

refclk_125m_board.xdc是针对clknetwork_inst这个子模块的吗?如果是的话,应该设置这个xdc文件的scoped_to_cells属性为“clknetwork_inst”

-vivian

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Hi, @justinhk ,

可以对这个Port 加io_buffer_type属性,禁止插入额外的IBUF. 

Ex: set_property  io_buffer_type  "none"  [get_ports in1]

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回复: 如何把IP 的 constraint propagate至top level?

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分別在top level 和ip 的xdc 嘗試了, 但沒效. clock ip 的xdc 有3個constraint , 分別是clkin1+/- 和reset, 但error 只針對reset pin. 有其他可能性嗎?
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回复: 如何把IP 的 constraint propagate至top level?

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这个IBUF是必须的,其他的管脚没有是因为都是差分的,而在子模块里有IBUFDS所以不需要再添加。

refclk_125m_board.xdc是针对clknetwork_inst这个子模块的吗?如果是的话,应该设置这个xdc文件的scoped_to_cells属性为“clknetwork_inst”

-vivian

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通過report_compile_order -constraints 去檢示xdc scope
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