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HLS如何显示多条关键路径?

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Hi,ALL

HLS在生成DCP后在Explore下面的impl/verilog/report/***_timing_synth.rpt里会有关键路径的信息,但是只有一条。

我想请教的是:有没有什么办法可以让HLS多显示几条关键路径?

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Xilinx Employee
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回复: HLS如何显示多条关键路径?

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Vivado在后台创建工程,跑synth和impl的脚本为/impl/verilog/impl.bat(sh),其中会用batch模式启动vivado,执行同目录下的run_vivado.tcl。

在run_vivado.tcl中,你可以看到synth完成后导出时序报告的命令:

report_timing -file $outputDir/${outputBaseName}_timing_synth.rpt

 

由于这些脚本都是HLS流程自动产生和执行的,如果你想修改(添加-max_paths xx选项),需要在HLS外的命令行单独执行。

还有一种方法是用Vivado打开此文件夹下创建的工程,open synthesized design,然后运行report timing summary查看更多的路径。

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Don't forget to reply, kudo, and accept as solution.
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Xilinx Employee
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回复: HLS如何显示多条关键路径?

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Vivado在后台创建工程,跑synth和impl的脚本为/impl/verilog/impl.bat(sh),其中会用batch模式启动vivado,执行同目录下的run_vivado.tcl。

在run_vivado.tcl中,你可以看到synth完成后导出时序报告的命令:

report_timing -file $outputDir/${outputBaseName}_timing_synth.rpt

 

由于这些脚本都是HLS流程自动产生和执行的,如果你想修改(添加-max_paths xx选项),需要在HLS外的命令行单独执行。

还有一种方法是用Vivado打开此文件夹下创建的工程,open synthesized design,然后运行report timing summary查看更多的路径。

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