Xilinx 产品设计与功能调试技巧

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Xilinx 产品设计与功能调试技巧

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BY WEN CHEN

提取实现任务级(task_level)的硬件并行算法是设计高效的HLS IP内核的关键。在本文中,我们将重点放在如何能够在不需要特殊的库或类的情况下修改代码风格以实现C代码实现并行性。 Xilinx HLS编译器的显着特征是能够将任务级别的并行性和流水线与可寻址的存储器PIPO或FIFO相结合。本文首先概述可以获取任务并行的前提条件,然后以DAG(directed acyclic graph) 代码为例,挖掘其中使用fork-join并行性,并结合使用ping- pong buffer启用了一种基于握手的任务级粗粒度的流水线形式。

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