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Visitor zhaolei
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注册日期: ‎01-21-2019

关于XCVU9P-1FLGA2104外挂QDRIV(CY7C4141KV13-667FCXC)初始化问题

最近开发了一种板卡(焊接两块),XCVU9P-1FLGA2104外挂1片36bit QDRIV(CY7C4141KV13-667FCXC),其中一块板卡加载官方下载的IP核(VIVADO 2017.1和2018.1都试了)demo程序后,初始化时弹出如下错误:

1147618663.jpg

行进到写数据操作的时候报错,感觉像是数据和时钟没对齐。并且无论怎么设置编译时的选项,都是执行到Write DQ to DK deskew出错。各位大神有没有遇到过?不知是否和原理图上CK_P及CK_N没有放到FPGA的GC脚(预布局的时钟要求放到了DBC脚)有关?另外此款QDR只能跑POD模式吗?IP核好像不能改模式?

第二块板卡烧写程序后没有反应,不弹出上述界面。硬件都是一样的。。。

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Xilinx Employee
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回复: 关于XCVU9P-1FLGA2104外挂QDRIV(CY7C4141KV13-667FCXC)初始化问题

你可以先尝试在板上跑IP example design,判断出错现象是否一致。在另一块板上,在左侧窗口里面没有显示MIG?命令窗口里有什么报错信息?

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Visitor zhaolei
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回复: 关于XCVU9P-1FLGA2104外挂QDRIV(CY7C4141KV13-667FCXC)初始化问题

目前在板上跑的就是官方的IP example design,并且管脚分配定义原理图和IP example design都是一样的。在另一块板上,在左侧窗口里面没有显示MIG,命令窗口里报错信息如下图所示:

1.jpg

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回复: 关于XCVU9P-1FLGA2104外挂QDRIV(CY7C4141KV13-667FCXC)初始化问题

根据错误信息,你需要修改debug_hub的时钟为控制器的系统钟输入。IP example design时序是否都满足?Vivado版本多少?板上有没有对QDRIV信号测量过?

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Visitor zhaolei
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回复: 关于XCVU9P-1FLGA2104外挂QDRIV(CY7C4141KV13-667FCXC)初始化问题

命令窗口里报错信息:

WARNING:[Labtools 27-3361]The debug hub core was not detected.

Resolution:

1.Make sure the clock cannected to the debug hub (dbg_hub)core is a free running clock and is active.

2.Make sure the BSCAN_SWITCH_USER_MASK device property in Vivado Hardware Manager the user scan chain setting in the design and refresh the device.

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Visitor zhaolei
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修改debug_hub的时钟为qdr ip核输出给用户用的时钟。

IP example design时序在编译时没有报错,是都满足的?

版本用的2017.4和2018.1都是同样的现象。

没有对qdr信号测量,主要测哪些信号?因pcb时没有预留测试点,不好测量。

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