该讨论区用于讨论Zynq UltraScale+ MPSoC/RFSoC, Zynq-7000, MicroBlaze, 和PicoBlaze相关问题。包括处理器子系统(PS)外设和可编程逻辑(PL)。没有被其他讨论区包含的IP外设如UART, USB, SATA, DDR, GEM, AXI Ethernet, I2C等。另外包括Zynq-7000和Zynq UltraScale+ SoC‘s的Vivado处理系统配置向导(PCW)。
该讨论区也用来讨论开发板上电、启动和配置的问题,包含Zynq-7000, Zynq UltraScale+ MPSoC和基于FPGA设计的MicroBlaze。
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