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Observer huagangxiaoyan
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注册日期: ‎11-15-2018

时序违约:分布式RAM内部出现hold违约

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问题描述:

       在工程中调用分布式RAM的IP核,且添加了输入和输出寄存器,无流水线设置。当进行时序仿真时,时钟频率设置为100Mhz,报告内部时序保持时间违约。从时序报告中列举的违约路径来看是分布式RAM中出现违约。将时钟频率降低为50Mhz之后重新生成时序报告,发现相同的地方出现相同的保持时间违约,且违约时间相同。

      因此,想请教这可能是由于哪里出现问题从而导致时序违约的出现。

单个路径的时序报告截图在上传的文件中。

选择其中的几条路径,查看他们的电路图。

 

我刚刚接触时序仿真,因此对于时序违约的原因不是很清楚,因此希望工程师能够给出一些建议,非常感谢

 

 

 

 

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已接受的解答
Moderator
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注册日期: ‎11-05-2010

回复: 时序违约:分布式RAM内部出现hold违约

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Hi, @huagangxiaoyan ,

综合阶段的时序都是估计值,对于不是很大的hold time违例可以暂时忽略.

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Moderator
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注册日期: ‎11-05-2010

回复: 时序违约:分布式RAM内部出现hold违约

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Hi, @huagangxiaoyan ,

1. Hold time的要求是0 ns,与频率无关.

2. cell 的状态是unplaced, 这是综合后时序报告? 最终布线以后的结果是什么?

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Observer huagangxiaoyan
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注册日期: ‎11-15-2018

回复: 时序违约:分布式RAM内部出现hold违约

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您好,我提供的报告确实是综合后的报告。我是根据ug906中的内容提示:应当在综合后满足时序要求后再进行布局布线。并且文档中提到如果保持时间无法满足,则设计无法正常工作,因此我还没有进入实现环节。

另外,我将违约的2560条路径全部打开后看到,全部是调用的分布式RAM中出现的违约。现在我已经将这部分内容利用RTL描述进行替换,之后不再出现违约报告。

这里我想请问的是:如果再次碰到保持时间违约的情况,有哪些是可能的原因?

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Moderator
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注册日期: ‎11-05-2010

回复: 时序违约:分布式RAM内部出现hold违约

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Hi, @huagangxiaoyan ,

综合阶段的时序都是估计值,对于不是很大的hold time违例可以暂时忽略.

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