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如何 通过sdx 工具,直接访问PL侧的DDR?

有几个问题, 1.首先是否需要在自定义平台时 将PL侧的MIG挂在 block design中? 如何链接?对应要输入什么样的tcl指令 2.我手边有zcu102 开发板,在软件的目录下发现了zcu102_mem(D:\Xilinx\SDx\2018.3\samples\platforms\zcu102_mem) 根据里面的main注释,这功能正是我想需要的,但是,官方没有给任何硬件说明,这样的平台如何搭建,以及访问MIG所有的函数 void* mig_alloc(size_t); 以库的形式封装,不能看到任何信息。 3.如何根据自己的开发板,用过sdx访问plddr? 4.zcu102_mem官方例程,硬件是什么样子的。
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Xilinx Employee
Xilinx Employee
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注册日期: ‎06-19-2019

从你的问题中,我没有理解你的最终需求是什么?

是不是你需要一个zcu102_mem官方例程比较完整的说明,包括硬件描述,以及软件使用?

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注册日期: ‎05-10-2016

是的。如果vivado 工程的tcl,或者是zcu102_mem的工程说明文档也可以。

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Xilinx Employee
Xilinx Employee
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注册日期: ‎06-19-2019

sdx会根据你写的应用程序自动去生成工程。生成的工程会在Debug或Release文件加下,藏的比较深,你可以查找一下,一般在prj文件夹下。

在SDx中也提供了大量的DEMO。我没有一个个去看,但是从名称和描述上,有一些是和DDR相关的,你可以找到符合你要求的,然后build一下就可以得到工程了。

下载DEMO的方法如下:

https://github.com/Xilinx/SDSoC-Tutorials/blob/master/getting-started-tutorial/lab-9-installing-applications-from-github.md

SDx软件使用方法如下:

https://github.com/Xilinx/SDSoC-Tutorials/blob/master/getting-started-tutorial/README.md

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注册日期: ‎05-10-2016

zcu102_mem的工程我找到了,在debug目录下,可以看到最原始的block design,

对应的example 里面提供了。控制mig 内存的库,但是没有给出源码

控制pl/ps通讯的函数控制pl/ps通讯的函数mig_alloc的头文件,没有原始文件mig_alloc的头文件,没有原始文件

我想用我自己的方式控制PLddr,

mig_alloc3.png

以上是我自己的方式写读 MIG,

问题很明显 ,pl port为m_axi 接口,起始的物理地址该如何设置,

比如我想读取pl mig的0地址的数据,我不知道该如何设置。

void pl2ps_data_copy(unsigned *pl, unsigned ps_buf[TRANS_LEN])

的pl 为一个linux中的虚拟地址,然而我想控制这个函数读取 mig中的物理地址,请问该如何读取?

 

这个问题可以延申一下。

我自己做过HLS的IP,通过standalone 或者 freertos 可以掉它提供的库,设置m_axi的寄存器之类的,但是sdx环境中我该如何设置这种寄存器?

 

 

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注册日期: ‎05-10-2016

我已经了解该如何进行物理地址控制了,采用 sds_mmap即可。
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Xilinx Employee
Xilinx Employee
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注册日期: ‎06-19-2019

good job!

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