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Observer wenhaohuang
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vivado2018.1仿真库编译问题

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 我在win7环境下使用DE modelsim10.6c编译vivado2018.1的仿真库时遇到如下错误:

ERROR: [Vivado 12-5603] compile_simlib failed to compile for modelsim with error in 1 library (cxl_error.log)

有人遇到类似的问题么?

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Xilinx Employee
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这是个已知问题。因为Modelsim DE只支持32位编译,换成SE/PE默认64位编译方式不会有此问题。

如果设计中不涉及此IP,请忽略此错误。

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Xilinx Employee
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请看一下compile_simlib.log,具体是编译哪个库报错呢?

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Observer wenhaohuang
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Library        | Language | Mapped Library Name | Error(s) | Warning(s) *

ldpc_v2_0_0 | verilog     ldpc_v2_0_0                    | 1           |            177 *

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Xilinx Employee
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这是个已知问题。因为Modelsim DE只支持32位编译,换成SE/PE默认64位编译方式不会有此问题。

如果设计中不涉及此IP,请忽略此错误。

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Observer wenhaohuang
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谢谢,你说的没错,确实可以完成我的仿真

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